In der modernen Elektronik bilden Leiterplattenbestückungen (PCBA) den Kern nahezu aller Geräte, von Unterhaltungselektronik bis hin zu Automobil- und Industriesystemen. Vias – kleine, kupferbeschichtete Strukturen, die verschiedene Lagen einer Leiterplatte verbinden – sind entscheidend für die elektrische Konnektivität und Signalübertragung. Unter wiederholten thermischen Zyklen werden Vias jedoch häufig zu einer Schwachstelle, was zu intermittierenden Fehlern, Unterbrechungen oder einem vollständigen Funktionsausfall führen kann. Das Verständnis der Gründe für das Versagen von Vias während thermischer Zyklen ist entscheidend, um die Zuverlässigkeit zu erhöhen, die Lebensdauer zu verlängern und die Ausfallraten in anspruchsvollen Umgebungen zu reduzieren.
Was ist thermisches Cycling und warum belastet es Vias?
Thermisches Zyklieren bezeichnet den wiederholten Prozess des Aufheizens und Abkühlens einer Leiterplatte (PCB) während des Betriebs oder Testens. Temperaturschwankungen führen dazu, dass sich die Materialien in einer Leiterplatte zyklisch ausdehnen und zusammenziehen, wodurch thermomechanische Spannungen entstehen. Im Gegensatz zu kurzfristigem thermischem Schock führt langfristiges thermisches Zyklieren zu kumulativen Ermüdungsschäden, insbesondere an Materialgrenzflächen und strukturellen Diskontinuitäten. Vias sind besonders anfällig, da sie aus Kupferbeschichtung und dielektrischen Substratmaterialien mit deutlich unterschiedlichen Wärmeausdehnungskoeffizienten (CTE) bestehen.
Für gängige Leiterplattenmaterialien wie FR‑4 liegt der CTE in der Ebene bei etwa 13–17 ppm/°C, während der CTE durch die Dicke (Z‑Achse) 60–70 ppm/°C erreichen kann. Im Gegensatz dazu hat Kupfer einen CTE von etwa 16–17 ppm/°C. Diese große Fehlanpassung entlang der Z‑Achse erzeugt bei Temperaturänderungen erhebliche Zug- und Schubspannungen in den Durchkontaktierungszylindern. Über Hunderte oder Tausende von Zyklen konzentriert sich die Spannung an Schwachstellen und führt schließlich zur Rissinitiierung und ‑ausbreitung.
Primäre Ausfallmechanismen von Vias unter thermischer Wechselbelastung
1. Durch CTE-Missverhältnis verursachte Zylinderrissbildung
Die häufigste Ausfallart ist das Aufreißen der Durchkontaktierungshülse, das in der Kupferbeschichtung des Vias auftritt. Die Z‑Achsen-Ausdehnung des dielektrischen Substrats ist deutlich größer als die von Kupfer. Beim Erwärmen drückt das Substrat die Via-Hülse nach außen; beim Abkühlen zieht es sie nach innen. Dieses wiederholte Dehnen und Stauchen führt zu Ermüdung in der Kupferschicht. Risse beginnen typischerweise an der Innenwand des Vias, breiten sich entlang der Korngrenzen aus und unterbrechen schließlich den leitfähigen Pfad.
Vias mit hohem Aspektverhältnis (Tiefen-zu-Durchmesser-Verhältnis > 8:1) sind besonders anfällig für diesen Ausfall. Schmale, tiefe Vias erschweren eine gleichmäßige Beschichtung, was zu dünnerem Kupfer in der Mitte des Lochzylinders führt. Dünnere Bereiche erfahren eine höhere Spannungskonzentration und reißen unter thermischer Zyklierung leichter.
2. Ausfälle in blinden, vergrabenen und gestapelten Vias
InHDI (High‑Density Interconnect) Leiterplatten,Blind Vias, Buried Viasund gestapelte Microvias bergen einzigartige Ausfallrisiken. Blindvias weisen häufig eine dünnere Beschichtung in der Nähe der Oberflächenverjüngung auf, die zu einem Bruchpunkt wird, wenn das sich ausdehnende Substrat dagegen drückt. Gestapelte Vias neigen dazu, an der Schnittstelle zwischen den Schichten auszufallen, was zu Verbindungen mit hohem Widerstand oder zu Unterbrechungen führt.
IPC‑Normen heben Zuverlässigkeitsbedenken für diese Strukturen hervor. IPC‑TM‑650 Methode 2.6.27 schreibt Thermozyklen- und Reflow‑Tests vor, um zu überprüfen, dass Widerstandsänderungen 5 % nicht überschreiten und so eine ausreichende Beständigkeit gegen thermische Ermüdung gewährleistet ist.
3. Schlechte Beschichtungsqualität und Strukturfehler
Die Zuverlässigkeit von Vias hängt stark von der Qualität der Beschichtung ab. Häufige Defekte umfassen ungleichmäßige Kupferdicke, Hohlstellen, Einschlüsse und unzureichende Beschichtungsdicke. Der sogenannte „Dogbone-Effekt“ beschreibt eine geringere Kupferdicke in der Mitte des Via-Zylinders im Vergleich zu den oberen und unteren Öffnungen. Eine derart nicht gleichmäßige Struktur erzeugt natürliche Kerbspannungen, die das Risswachstum unter thermischer Belastung beschleunigen.
Hohlräume oder Lücken in der Kupferbeschichtung verringern zusätzlich die mechanische Festigkeit und elektrische Leitfähigkeit. Selbst kleine Hohlräume können sich unter zyklischer Belastung ausdehnen und zu einem schnellen Ausfall führen. Die Branche empfiehlt im Allgemeinen eine minimale Kupferbeschichtungsdicke von 25 μm (1 mil) für eine stabile Via‑Leistung unter thermischer Belastung.
4. Unzureichende Materialauswahl und Substratleistung
Substratmaterialien beeinflussen die Zuverlässigkeit von Vias unter thermischer Zyklisierung direkt. Materialien mit niedrigem Tg (Glasübergangstemperatur) erweichen bereits bei relativ niedrigen Temperaturen, was das Risiko von Verformung, Delamination und Via‑Rissbildung erhöht. Eine hohe Feuchtigkeitsaufnahme kann außerdem während des Reflow‑Lötens oder beim Betrieb bei hohen Temperaturen zu innerer Verdampfung führen und die Via‑Strukturen von innen schädigen.
Die Verwendung von Laminaten mit niedrigem CTE verringert den Ausdehnungsunterschied zwischen Substrat und Kupfer und reduziert dadurch die thermomechanischen Spannungen. Hochleistungsmaterialien mit ausgewogenem CTE und hoher thermischer Stabilität verbessern die Überlebensrate von Vias während thermischer Zyklen erheblich.
5. Interne Schichttrennung und Schnittstellenablösung
Ein weiterer Ausfallmodus ist die Innenlagentrennung (ILS), die die Ablösung der Kupferfolie, die Delamination zwischen Grundkupfer und galvanisch abgeschiedenem Kupfer oder eine Trennung an der Kupfer-Substrat-Grenzfläche umfasst. Im Gegensatz zu Fassungsrissen, die durch einen CTE-Missabgleich in der Z-Achse verursacht werden, wird ILS durch die in der Ebene liegende Ausdehnung des Harzes hervorgerufen, das gegen den Via-Zylinder drückt. Dicke, hochwertige Kupferbeschichtungen können dieser Verformung widerstehen und die Trennung verzögern oder verhindern. Dünne oder schwache Beschichtungen führen zu plastischer Verformung und hoher Zugspannung, was Trennungsfehler auslöst.
Wie thermische Zyklen den Ausfall von Vias beschleunigen
Thermische Zyklen beschleunigen den Ausfall durch drei miteinander verbundene Mechanismen:
Kumulative Ermüdung: Umkehrbare thermische Ausdehnung und Kontraktion verursachen zyklische Belastungen, die Kupfer und Schnittstellen im Laufe der Zeit schwächen.
Spannungskonzentration: Defekte, Geometrieänderungen und Materialunterschiede erzeugen lokale Spannungsbereiche, an denen Risse entstehen und wachsen.
MaterialabbauHohe Temperaturen beschleunigen Kriechen, Oxidation und Schnittstellenabbau, während niedrige Temperaturen die Sprödigkeit erhöhen und Materialien bruchanfälliger machen.
Zusammen führen diese Faktoren dazu, dass geringfügige Herstellungs- oder Designfehler sich über den Produktlebenszyklus hinweg in katastrophale Ausfälle verwandeln.
Design- und Fertigungslösungen zur Verbesserung der Via-Zuverlässigkeit
Um Ausfälle von Vias während thermischer Zyklen zu verringern, können Ingenieure und Hersteller die folgenden Strategien umsetzen:
Über Geometrie optimieren: Reduzieren Sie das Aspektverhältnis, indem Sie den Via-Durchmesser für tiefere Strukturen vergrößern. Vermeiden Sie übermäßig hohe Aspektverhältnisse, die die Gleichmäßigkeit der Beschichtung beeinträchtigen.
Galvanikprozesse verbessern: Verwenden Sie Pulsstromabscheidung und gerührte Elektrolyte mit niedriger Viskosität, um eine gleichmäßige Kupferdicke sicherzustellen. Befolgen Sie die IPC‑Normen für die minimale Beschichtungsdicke.
Hochleistungsmaterialien auswählenWählen Sie Substrate mit hoher Tg, niedrigem CTE und geringer Feuchtigkeitsaufnahme, um thermische Spannungen und Materialinstabilität zu minimieren.
Verwendung robuster Via-Strukturen: Bevorzugen Sie in HDI-Designs Mikrovias mit geringeren Aspektverhältnissen. Wenden Sie kontrolliertes Via-Filling (leitfähig oder nicht leitfähig) an, um die mechanische Festigkeit zu erhöhen und das Hochziehen von Lot zu verhindern.
StrengZuverlässigkeitstests: Führen Sie beschleunigte thermische Zyklen gemäß den Normen IPC‑9701 und IPC‑TM‑650 durch, um Schwachstellen frühzeitig zu erkennen. Überwachen Sie während der Prüfung die Widerstandsänderungen in Echtzeit.
Fazit
Vias fallen während thermischer Zyklen hauptsächlich aufgrund des CTE-Mismatchs zwischen Kupfer und Substrat, suboptimalem Design, unzureichender Beschichtungsqualität und ungeeigneter Materialauswahl aus. Diese Faktoren führen zu Barrel-Rissen, Innenlagenablösungen, Grenzflächen-Delamination und struktureller Ermüdung. Da Elektronik zunehmend in rauen Umgebungen eingesetzt wird – insbesondere in Automobil-, Industrie- und Outdoor-Anwendungen – wird die Zuverlässigkeit von Vias unter thermischer Zyklisierung zu einem entscheidenden Faktor für Systemleistung und Lebensdauer.
Durch die Beseitigung von Ursachen auf Root-Ebene mittels Materialoptimierung, robustem Design, präziser Fertigung und strengen Zuverlässigkeitstests ist es möglich, Via-Ausfälle deutlich zu reduzieren und eine stabile PCBA-Leistung über Tausende von thermischen Zyklen hinweg sicherzustellen.
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