Cartes de circuits imprimés à interconnexion haute densité (HDI)font une partie essentielle de la fabrication électronique moderne, car elles sont de plus en plus utilisées dans des dispositifs plus petits et plus complexes avec des vitesses de traitement plus élevées. Les possibilités vont des smartphones et de l’électronique portable aux systèmes de contrôle automobiles et à l’électronique médicale, jusqu’aux circuits imprimés compacts et haute performance qui ne sont pas possibles avec des cartes traditionnelles.
Mais la fabrication de circuits imprimés HDI comporte un certain nombre de défis en matière de production et de fiabilité. L’un des plus importants (mais fréquemment négligé) est le dégagement du vernis épargne. La conception du vernis épargne a une influence directe sur la précision de l’assemblage, la fiabilité des joints de soudure, l’isolation électrique du produit et la capacité de fonctionnement à long terme du produit.
Dans des environnements de PCB ultra-denses où la largeur et l’espacement des pistes se mesurent en microns, même un léger désalignement du vernis épargne-soudure ou un dégagement insuffisant peut entraîner des défauts de fabrication importants et des défaillances en fonctionnement.
Qu’est-ce que la distance de dégagement du vernis épargne ?
Le dégagement du vernis épargne est défini comme la distance entre le bord d’un élément en cuivre, comme un plot, un via ou une piste, et le bord de l’ouverture du vernis épargne autour de cet élément en cuivre. En réalité, le vernis épargne est une fine couche de polymère protecteur déposée sur le dessus du circuit imprimé afin de fournir une couche d’isolation électrique entre les circuits en cuivre et d’éviter les soudures indésirables lors de l’assemblage des cartes.
En exposant la zone de cuivre créée dans l’ouverture du vernis épargne, les composants peuvent être soudés sur la carte, tout en laissant la zone conductrice exposée protégée par le masque environnant.
Dans les conceptions de circuits imprimés HDI, le dégagement du vernis épargne joue un rôle particulièrement important du fait que la distance entre les éléments conducteurs est très faible. Un bon alignement et un dégagement approprié du vernis sont essentiels pour la fabricabilité et la fiabilité électrique.
Pourquoi le dégagement du vernis épargne est crucial dans la conception de circuits imprimés HDI
Prévention des ponts de soudure et des courts-circuits
Des composants à pas fin comme les BGA, les CSP et les microvias sont fréquemment utilisés dans les circuits HDI. En général, ces boîtiers comportent également un espacement de moins de 0,5 mm entre les pastilles, ce qui facilite l’assemblage.
Lorsqu’il existe un large espace pour le vernis épargne, une exposition excessive du cuivre peut se produire et un pontage de soudure entre les pastilles de connexion peut devenir possible lors de la refusion. En revanche, un faible espacement peut amener le vernis épargne à recouvrir partiellement les pastilles sur le circuit imprimé en raison des tolérances de repérage, ce qui peut entraîner des problèmes de soudabilité et de fixation des composants.
La séparation efficace obtenue grâce à des ouvertures de vernis épargne bien contrôlées contribue également à réduire le risque de courts-circuits et à améliorer les cadences d’assemblage.
Amélioration de la fiabilité des joints de soudure
D’un point de vue mécanique et électrique, des joints de soudure fiables sont nécessaires pour garantir la stabilité globale des assemblages HDI. Une mauvaise conception du vernis épargne-soudure peut empêcher la pâte à braser d’adhérer correctement aux composants ou entraîner un mauvais étalement de la soudure.
Si le vernis épargne remonte sur les pastilles, les joints de soudure peuvent ne pas être uniformes, entraînant une liaison mécanique irrégulière ou une connexion électrique incohérente. Ces défauts peuvent, avec le temps, provoquer des pannes intermittentes, une faible durée de vie du produit ou de la fatigue thermique.
L’écoulement uniforme de la brasure et les interconnexions qui en résultent, plus solides et plus fiables, sont le résultat d’un dégagement de vernis épargne optimisé.
Soutenir la fabrication de haute précision
Des procédés avancés tels que les microvias percés au laser, la stratification séquentielle, les pistes ultra-fines et les structures de vias empilés sont utilisés pour la fabrication HDI moderne. Avec l’augmentation de la précision et de l’exactitude des équipements de fabrication, l’alignement du vernis épargne continue de s’appuyer sur l’utilisation de tolérances de fabrication.
Les tolérances typiques de repérage du vernis épargne sont de ±2 mils à ±3 mils, en fonction des capacités du procédé de fabrication et de la complexité de la carte. Dans les structures ultra-HDI, ces tolérances sont très importantes.
Ces variations doivent être prises en compte lors de la conception des implantations. Des marges de dégagement inférieures aux tolérances souhaitées peuvent entraîner un chevauchement du vernis épargne sur les pastilles ou une exposition indésirable du cuivre, ce qui peut avoir un impact négatif sur la fabricabilité.
La relation entre le vernis épargne et les composants à pas fin
Plus la densité des composants est élevée, plus il est difficile de maintenir les barrières de vernis épargne en place. La longueur de matériau de vernis épargne entre des pastilles adjacentes qui empêche la formation de ponts de soudure est appelée une barrière de vernis épargne.
Dans certains dispositifs à pas très fin, l’espace est limité pour l’utilisation de barrières traditionnelles de vernis épargne. Dans ces cas, les fabricants peuvent proposer des variantes de conception selon les besoins de fabrication et d’assemblage.
Pour optimiser les performances électriques et garantir la fabricabilité, les routages HDI à pas fin exigent une collaboration étroite entre le concepteur de PCB, le fabricant et l’ingénieur d’assemblage.
Plots définis par le vernis épargne vs. plots non définis par le vernis épargne
En IDHFabrication de circuits imprimés, il existe deux approches populaires pour concevoir les pastilles :
Pastilles non définies par le masque de soudure (NSMD)
Les conceptions NSMD présentent une ouverture dans le vernis épargne légèrement plus grande que la pastille en cuivre, de sorte que toute la surface de cuivre et les bords de la pastille soient exposés. En général, cette structure offre une meilleure mouillabilité de la brasure et une fiabilité accrue du joint de soudure.
Pour les applications BGA à pas fin, on préfère généralement utiliser des pastilles NSMD, car elles forment des joints de soudure plus homogènes.
Pastilles définies par le vernis épargne (SMD)
Si l’ouverture du vernis épargne dans la conception SMD est plus petite que le plot en cuivre, une partie du bord du plot en cuivre sera recouverte par le vernis épargne. Cela peut être utile si l’espace disponible pour la soudure est très limité ; cependant, cela peut également affecter la géométrie des connexions de soudure et la répartition de leurs contraintes.
Les structures NSMD ou SMD sont choisies en fonction du type de composant, de son pas, de la densité de la carte et des contraintes de fabrication.
Défis courants dans la conception du vernis épargne pour circuits HDI
Désalignement du vernis épargne
Un léger écart d’alignement peut révéler le cuivre ou masquer partiellement les zones soudables. Pour les circuits imprimés HDI, qui présentent un espacement très réduit, la précision de l’enregistrement devient cruciale.
Largeur réduite de l’ouverture du vernis épargne
Avec la réduction de l’espacement entre pistes et pastilles, il devient plus difficile de maintenir les barrières de vernis épargne. La faible largeur de ces barrières peut conduire à des ponts de soudure lors de l’assemblage.
Trace et microvia ultra-fins
Les circuits imprimés HDI peuvent inclure des microvias percés au laser et des pistes de moins de 3 mils d’épaisseur. Ces miniatures exigent des procédés extrêmement contrôlés pour l’application du vernis épargne afin de garantir la stabilité dimensionnelle.
Contraintes thermiques et mécaniques
Les contraintes peuvent se concentrer autour des joints de soudure en raison d’une mauvaise conception du vernis épargne, en particulier lorsqu’il y a des cycles thermiques, des vibrations ou des flexions mécaniques.
Meilleures pratiques pour optimiser le dégagement du vernis épargne
Voici quelques conseils que les concepteurs de PCB doivent suivre pour faire de cette tâche une opération simple et fiable, avec une fabricabilité et une HDI améliorées :
Respecter les normes IPC / les directives de conception recommandées par les fabricants
Déterminer les dégagements du vernis épargne pour respecter les tolérances réelles de fabrication
Ne pas espacer de manière excessivement agressive dans les zones à pas fin
Vérifier auprès du fabricant de PCB la taille minimale de barrage de vernis épargne
Appliquer l’analyse de conception pour la fabricabilité (DFM) dès le début de la conception
Tester les prototypes avant la production de masse
En coordination, concevez le vernis épargne conformément au pochoir etprocessus d’assemblageexigences.
Pour les applications avancées d’interconnexion à haute densité, utilisez des vernis épargne LPI (photoimageables liquides) à haute résolution.
Tendances émergentes dans la technologie des vernis épargne ultra-HDI
Cependant, les procédés classiques de vernis épargne évoluent rapidement à mesure que la technologie des circuits imprimés progresse vers des structures à ultra-haute densité et des densités d’assemblage similaires à celles des semiconducteurs.
Les évolutions émergentes comprennent :
Imagerie directe par laser (LDI) pour une précision accrue de l’alignement des masques
Matériaux pour vernis épargne photosensible avancé
Le vernis épargne est traité à l’aide d’un procédé de résolution plus fine
Optimisation DFM assistée par l’IA
Tests de fiabilité améliorés pour les applications à haute fréquence et à grande vitesse.
Ces innovations permettent aux fabricants de se rapprocher des tolérances et d’obtenir un assemblage fiable dans les produits électroniques actuels, qui deviennent de plus en plus compacts.
Il s’agit d’un élément fondamental dans la conception de circuits imprimés HDI, qui affecte directement la précision de fabrication et le rendement d’assemblage, les performances électriques ainsi que la fiabilité à long terme des produits. Avec l’électronique haute densité d’aujourd’hui, où l’espacement entre les composants se réduit, il n’a jamais été aussi important de disposer d’une conception de vernis épargne adéquate.
Les ingénieurs peuvent minimiser les défauts dansAssemblage de circuits impriméset améliorer les performances de leurs circuits imprimés en optimisant soigneusement les dégagements du vernis épargne, en assurant des barrages de vernis épargne adéquats et en tenant compte des tolérances de fabrication.
Avec l’évolution continue de la technologie HDI, les fabricants et les concepteurs doivent utiliser les outils et les technologies nécessaires pour prendre en charge la prochaine génération de systèmes électroniques, qui deviennent toujours plus petits et plus rapides.
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Ressources utiles
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