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高混載SMT実装を効率化するためのパネル化およびアレイ設計ガイドライン

Last Updated: Sep 01, 2026

多品種少量(HMLV)のPCBA生産においては、パネルアレイ設計は段取り替え時間やユニット当たりの組立コストに直接的かつ定量的な影響を与えます――この影響はレイアウト段階では見落とされがちです。アレイがSMTラインの実際のプロセス能力に合致していない場合、そのコストは、段取り時間の延長、面付け分割時に発生する回避可能なスクラップ、およびパネル端部に最も近い基板の初回合格率の低下という形で顕在化します。

なぜHMLV生産においてパネル化戦略が重要なのか


SMT pick and place machine assembling PCBA panel


HMLV製造では、ロットサイズは一般的に小さく、ジョブの切り替えが頻繁に行われます。高ボリューム生産では無視できるような固定費用――印刷/ディスペンスプログラムのセットアップと位置合わせ、実装プログラムのロード、初品検査、パネルのロード/アンロード――も、数十枚から数百枚程度の基板にしか分散されない場合には、1ユニット当たりの総コストに占める割合がはるかに大きくなります。

パネル化は、この固定費負担を直接削減できる数少ない設計段階の手段の一つです。というのも、パネル化によって、1回の装置サイクルあたりに印刷、実装、リフロー、検査を通過する基板の枚数が変化するからです。

・固定セットアップコスト(印刷/ディスペンス登録、プログラムセットアップ、初品検査)を、ボードごとに一度ずつ支払うのではなく、パネル内のすべてのボードにわたって償却する

•        特に小型または不規則な形状の設計において、完成基板1枚あたりの手作業による取り扱いを削減

・パネルごとに一度だけループを確立する方式で、基板ごとに確立する方式ではないため、SPI/AOI 初品修正の一貫性がより高くなる

トレードオフとして、材料歩留まり ― つまり 1 枚のシートから絞り出せる基板枚数 ― の最大化だけを目的として最適化されたパネルは、分割時の応力、基準マーク(フィデューシャル)の視認性、あるいは熱の均一性を無視してしまうと、こうした利点を損なう可能性があります。HMLV 向けのパネル設計は、単なる基板枚数ではなく、段取り替え効率と歩留まりに対して評価されるべきです。

Vカット vs. タブルート:最適な基板分割方法の選択


V-cut and tab-route panel separation methods


最も一般的な2つの分割方法は、スループット、基板形状の柔軟性、および端部部品に与える機械的ストレスが異なるため、単なるデフォルトではなく、実際に設計上の判断が必要な選択となる。

Vカット(Vスコア)

・スコアラインに沿って内部の切り抜きがない、直線エッジの長方形基板に最も適しています

・ルーティングよりもシンプルで、通常は実行もより高速です。一直線のVスコアは、ルーティングされたタブ形状のようにCNCツールパスのプログラミングやカッター摩耗の管理を必要としません。

• 単一直線上に分離応力を集中させ、その応力がスコア付近のはんだ接合部や配線に直接伝達される可能性がある ― Vスコア近傍のセラミックチップコンデンサやBGAコーナーボールが最も一般的な被害例である

タブルート(有孔タブ/マウスバイト)

・不規則な基板外形、内部スロットや切り欠き、および同じパネル上で異なるボード形状を組み合わせる— HMLV では一般的であり、1 回のパネル運転で複数のジョブに対応する必要がある場合がある

•        連続したラインに沿ってではなく、離散的なタブ位置で分離時の応力を分散させることで、タブの配置を敏感なコンポーネントの周囲に合わせて計画することが可能になる

・各タブの分割ポイントごとに、目に見える基板外形だけでなく、部品本体、そのはんだ接合部、およびルーティング工具自体の包絡領域についてもクリアランス計画が必要となる

意思決定ロジック

Vカットは、分離時間の短縮が最も重要で、かつパネル端に部品が近接していない単純な長方形基板に対して、合理的なデフォルト選択となります。タブルートは、基板外形が不規則な場合、パネル内に異なる設計の基板が混在する場合、あるいはフレックスに敏感なはんだ接合部(コネクタ、電解コンデンサ、大型BGA、基板端面実装部品など)を持つ部品が、どうしても分割ライン付近に配置されてしまう場合に、より安全な選択肢となります。いずれの場合も、部品/銅箔と分割用フィーチャとの最小クリアランスはレイアウト段階で設定しておく必要があり、最終検査時に修正できるものではありません。

エッジクリアランスおよび間隔の正確な要件は、組立業者や分離方法によって異なるため、最新の要件を必ず確認してください。パネル要件配列を確定する前に、あなたのビルド用として。

配置精度のためのフィデューシャルおよび工程境界設計


PCB fiducial marks and process border rails


パネル化されたアレイにおける実装精度は、多層構造のフィデューシャル方式と、生産ライン全体を通してその方式の判読性を維持するよう設計されたプロセス境界に依存します。

・パネルレベル(グローバル)のフィデューシャル:検出なしにパネルが180°逆向きで装着されることがないよう、非対称に配置された最低3つ以上

・ボードレベル(ローカル)フィデューシャル:通常、個々のボードごとに2~3個を使用し、パネル内でのボードレベルの位置ずれや回転を補正するために対角コーナーに配置される

・コンポーネントレベルのローカル基準マーク:パネルおよび基板レベルの基準マークだけではファインピッチ実装に対して十分な精度が得られないため、微細ピッチBGAおよびQFNパッケージの近傍に追加され、局所的な座標補正に使用される

・   プロセスボーダー/レール:基準マークおよび治具用の穴を備え、能動回路部分から離して配置されることで、コンベアクランプやマシンビジョンシステムがパネルの搬送エッジに支障なくアクセスできるようにする

この基準マークの階層構造こそが、当社の MYCRONIC ジェットプリンターおよび 3D SPI システムがペースト印刷位置合わせとクローズドループ補正を行う際に依拠しているものです。もし基準マークがソルダーマスクの下にあったり、割りラインに近すぎたり、ある工程ステップ中にコンベアクランプで覆われてしまう位置に配置されていたりすると、本来その基準マークで検出・補正されるはずだった部品配置や印刷オフセットは補正されないままになり、その結果を 3D AOI が上流で未然に防ぐのではなく、下流で検出することになってしまいます。

パネルサイズ設定:リフロー均一性およびSPI/AOIサイクルタイム


SMT reflow oven and carrier fixture for PCBA


パネル寸法は材料歩留まりだけでなく、リフロー時の熱均一性や、ロットあたりの検査サイクルタイムにも影響を及ぼします。

・より大きなパネルは、リフロー炉のゾーンを通過する際に、パネル中央部とレール端部との間でより大きな温度差が生じる可能性があり、これは JTR-1200D-N を通過する異なる厚みの HMLV パネルにとって特に重要となります。

・薄型または大型フォーマットの基板は、リフロー加熱時に反りが発生しやすく、ここで人工石の設備は、反りの影響を受けやすい基板上でパネルの平坦度を保持し、BGA/QFN の共面性を保護するために使用されます

・3D SPI および 3D AOI によるインデックス処理が行われる各パネルには、パネルサイズに関係なく固定の検査工程が追加されるため、非常に小さいパネルではロットあたりのインデックスサイクル数が増加し、一方で非常に大きいパネルでは、1 サイクルあたりの検査エリアと潜在的な不良数が増加する

実務的な目標は、特定のスタックアップ構成および部品構成に対して、熱プロファイルと反りがプロセスウィンドウ内に収まるパネルサイズとしつつ、そのロットの目標スループットに対して SPI/AOI のインデックス回数を妥当な範囲に保つことです。BGA/QFN のボイド検査用オフライン X 線検査は、通常 SPI/AOI と同様に、個々の基板を分割する前のパネルレベルで段取り・インデックスされるため、同じパネルサイズのトレードオフがそこにも適用されます。分割後のリワークアクセスについては、事後に判明するのではなく、設計段階で必ず確認しておく必要があります。

パネル化設計チェックリスト

・パネルごとの基板枚数は、単なる最大材料歩留まりだけでなく、段取り替えの頻度に合わせて設定される

・分割方法(Vカットまたはタブルート)が、基板外形および端部部品の脆弱性に適合していること

・すべての分離フィーチャーと部品/銅箔との間に、最小クリアランスが維持されていること

・パネルレベルの位置合わせマーク(3個以上、非対称)に加えて、基板レベルおよびファインピッチ用のローカル位置合わせマークもすべて指定されている

・プロセスボーダー/レールは、治具用の穴を設けるのに十分な幅があり、かつコンベアクランプの移動範囲から離れていること

・割り当てられたスタックアップに対して、パネルサイズがリフロー時の熱均一性に照らして確認されている

・パネルの剛性および反りのリスクを評価し、必要に応じて治具による支持を指定した

・SPI/AOIのインデックスカウントがロットの目標スループットと比較検討された

・パネル分割後のテストおよびリワーク用アクセスが確認されたこと

ガーバーデータを送信してパネル化レビューを受ける

レイアウト段階で行われる面付けの決定は、一度アレイが量産に入ると、修正が困難でコストも高くつきます。HMLV組立向けに基板設計を最終確定する場合は、リリース前にガーバーデータを提出して、面付けおよびDFMレビューを受けてください。実際にあなたのジョブが流れるSMTラインのプロセス能力に照らして、分割方法、位置合わせマーク(フィデューシャル)の配置、基板端のクリアランス、およびパネルサイズを確認します。

便利なリソース

産業用PCBAのためのDFM監査チェックリスト:手戻り率を削減する38の設計ルール

BGAボイド率許容基準参照:IPC-7095DおよびIPC-A-610クラス基準

産業および医療用組立品向け IPC-A-610 クラス 3 外観検査ガイド

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